-
Notifications
You must be signed in to change notification settings - Fork 0
/
PROJECT.map.rpt
2971 lines (2823 loc) · 382 KB
/
PROJECT.map.rpt
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
124
125
126
127
128
129
130
131
132
133
134
135
136
137
138
139
140
141
142
143
144
145
146
147
148
149
150
151
152
153
154
155
156
157
158
159
160
161
162
163
164
165
166
167
168
169
170
171
172
173
174
175
176
177
178
179
180
181
182
183
184
185
186
187
188
189
190
191
192
193
194
195
196
197
198
199
200
201
202
203
204
205
206
207
208
209
210
211
212
213
214
215
216
217
218
219
220
221
222
223
224
225
226
227
228
229
230
231
232
233
234
235
236
237
238
239
240
241
242
243
244
245
246
247
248
249
250
251
252
253
254
255
256
257
258
259
260
261
262
263
264
265
266
267
268
269
270
271
272
273
274
275
276
277
278
279
280
281
282
283
284
285
286
287
288
289
290
291
292
293
294
295
296
297
298
299
300
301
302
303
304
305
306
307
308
309
310
311
312
313
314
315
316
317
318
319
320
321
322
323
324
325
326
327
328
329
330
331
332
333
334
335
336
337
338
339
340
341
342
343
344
345
346
347
348
349
350
351
352
353
354
355
356
357
358
359
360
361
362
363
364
365
366
367
368
369
370
371
372
373
374
375
376
377
378
379
380
381
382
383
384
385
386
387
388
389
390
391
392
393
394
395
396
397
398
399
400
401
402
403
404
405
406
407
408
409
410
411
412
413
414
415
416
417
418
419
420
421
422
423
424
425
426
427
428
429
430
431
432
433
434
435
436
437
438
439
440
441
442
443
444
445
446
447
448
449
450
451
452
453
454
455
456
457
458
459
460
461
462
463
464
465
466
467
468
469
470
471
472
473
474
475
476
477
478
479
480
481
482
483
484
485
486
487
488
489
490
491
492
493
494
495
496
497
498
499
500
501
502
503
504
505
506
507
508
509
510
511
512
513
514
515
516
517
518
519
520
521
522
523
524
525
526
527
528
529
530
531
532
533
534
535
536
537
538
539
540
541
542
543
544
545
546
547
548
549
550
551
552
553
554
555
556
557
558
559
560
561
562
563
564
565
566
567
568
569
570
571
572
573
574
575
576
577
578
579
580
581
582
583
584
585
586
587
588
589
590
591
592
593
594
595
596
597
598
599
600
601
602
603
604
605
606
607
608
609
610
611
612
613
614
615
616
617
618
619
620
621
622
623
624
625
626
627
628
629
630
631
632
633
634
635
636
637
638
639
640
641
642
643
644
645
646
647
648
649
650
651
652
653
654
655
656
657
658
659
660
661
662
663
664
665
666
667
668
669
670
671
672
673
674
675
676
677
678
679
680
681
682
683
684
685
686
687
688
689
690
691
692
693
694
695
696
697
698
699
700
701
702
703
704
705
706
707
708
709
710
711
712
713
714
715
716
717
718
719
720
721
722
723
724
725
726
727
728
729
730
731
732
733
734
735
736
737
738
739
740
741
742
743
744
745
746
747
748
749
750
751
752
753
754
755
756
757
758
759
760
761
762
763
764
765
766
767
768
769
770
771
772
773
774
775
776
777
778
779
780
781
782
783
784
785
786
787
788
789
790
791
792
793
794
795
796
797
798
799
800
801
802
803
804
805
806
807
808
809
810
811
812
813
814
815
816
817
818
819
820
821
822
823
824
825
826
827
828
829
830
831
832
833
834
835
836
837
838
839
840
841
842
843
844
845
846
847
848
849
850
851
852
853
854
855
856
857
858
859
860
861
862
863
864
865
866
867
868
869
870
871
872
873
874
875
876
877
878
879
880
881
882
883
884
885
886
887
888
889
890
891
892
893
894
895
896
897
898
899
900
901
902
903
904
905
906
907
908
909
910
911
912
913
914
915
916
917
918
919
920
921
922
923
924
925
926
927
928
929
930
931
932
933
934
935
936
937
938
939
940
941
942
943
944
945
946
947
948
949
950
951
952
953
954
955
956
957
958
959
960
961
962
963
964
965
966
967
968
969
970
971
972
973
974
975
976
977
978
979
980
981
982
983
984
985
986
987
988
989
990
991
992
993
994
995
996
997
998
999
1000
Analysis & Synthesis report for PROJECT
Mon Nov 26 11:05:19 2018
Quartus II 64-Bit Version 13.0.1 Build 232 06/12/2013 Service Pack 1 SJ Web Edition
---------------------
; Table of Contents ;
---------------------
1. Legal Notice
2. Analysis & Synthesis Summary
3. Analysis & Synthesis Settings
4. Parallel Compilation
5. Analysis & Synthesis Source Files Read
6. Analysis & Synthesis Resource Usage Summary
7. Analysis & Synthesis Resource Utilization by Entity
8. Analysis & Synthesis RAM Summary
9. Analysis & Synthesis DSP Block Usage Summary
10. Analysis & Synthesis IP Cores Summary
11. State Machine - |PROJECT|UART_state
12. State Machine - |PROJECT|state
13. State Machine - |PROJECT|VGA_SRAM_interface:VGA_unit|VGA_SRAM_state
14. State Machine - |PROJECT|UART_SRAM_interface:UART_unit|UART_SRAM_state
15. State Machine - |PROJECT|UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state
16. State Machine - |PROJECT|Milestone_1:M1_unit|state
17. State Machine - |PROJECT|Milestone_1:M1_unit|RGB_Converter:RGB_unit|sel_rgb_mul
18. State Machine - |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit|sel_mul_in
19. State Machine - |PROJECT|Milestone_2:M2_unit|state
20. State Machine - |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state
21. State Machine - |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|state
22. State Machine - |PROJECT|Milestone_2:M2_unit|FS:FS_unit|state
23. State Machine - |PROJECT|Milestone_2:M2_unit|Milestone_3:M3_unit|state
24. State Machine - |PROJECT|Milestone_2:M2_unit|WS:WS_unit|state
25. Registers Removed During Synthesis
26. Removed Registers Triggering Further Register Optimizations
27. General Register Statistics
28. Inverted Register Statistics
29. Multiplexer Restructuring Statistics (Restructuring Performed)
30. Source assignments for Milestone_2:M2_unit|Milestone_3:M3_unit|dual_port_RAM3:dual_port_RAM_inst3|altsyncram:altsyncram_component|altsyncram_0r92:auto_generated
31. Source assignments for Milestone_2:M2_unit|dual_port_RAM0:dual_port_RAM_inst0|altsyncram:altsyncram_component|altsyncram_tq92:auto_generated
32. Source assignments for Milestone_2:M2_unit|dual_port_RAM1:dual_port_RAM_inst1|altsyncram:altsyncram_component|altsyncram_uq92:auto_generated
33. Source assignments for Milestone_2:M2_unit|dual_port_RAM2:dual_port_RAM_inst2|altsyncram:altsyncram_component|altsyncram_vq92:auto_generated
34. Parameter Settings for User Entity Instance: Milestone_2:M2_unit|Milestone_3:M3_unit|dual_port_RAM3:dual_port_RAM_inst3|altsyncram:altsyncram_component
35. Parameter Settings for User Entity Instance: Milestone_2:M2_unit|dual_port_RAM0:dual_port_RAM_inst0|altsyncram:altsyncram_component
36. Parameter Settings for User Entity Instance: Milestone_2:M2_unit|dual_port_RAM1:dual_port_RAM_inst1|altsyncram:altsyncram_component
37. Parameter Settings for User Entity Instance: Milestone_2:M2_unit|dual_port_RAM2:dual_port_RAM_inst2|altsyncram:altsyncram_component
38. Parameter Settings for User Entity Instance: SRAM_Controller:SRAM_unit|Clock_100_PLL:Clock_100_PLL_inst|altpll:altpll_component
39. Parameter Settings for User Entity Instance: VGA_SRAM_interface:VGA_unit
40. Parameter Settings for User Entity Instance: VGA_SRAM_interface:VGA_unit|VGA_Controller:VGA_unit
41. Parameter Settings for Inferred Entity Instance: Milestone_1:M1_unit|RGB_Converter:RGB_unit|lpm_mult:Mult0
42. Parameter Settings for Inferred Entity Instance: Milestone_1:M1_unit|RGB_Converter:RGB_unit|lpm_mult:Mult1
43. Parameter Settings for Inferred Entity Instance: Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult3
44. Parameter Settings for Inferred Entity Instance: Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult0
45. Parameter Settings for Inferred Entity Instance: Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult1
46. Parameter Settings for Inferred Entity Instance: Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult2
47. Parameter Settings for Inferred Entity Instance: Milestone_1:M1_unit|FIR:FIR_unit|lpm_mult:Mult0
48. Parameter Settings for Inferred Entity Instance: Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult3
49. Parameter Settings for Inferred Entity Instance: Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult0
50. Parameter Settings for Inferred Entity Instance: Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult1
51. Parameter Settings for Inferred Entity Instance: Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult2
52. altsyncram Parameter Settings by Entity Instance
53. altpll Parameter Settings by Entity Instance
54. lpm_mult Parameter Settings by Entity Instance
55. Port Connectivity Checks: "convert_hex_to_seven_segment:unit3"
56. Port Connectivity Checks: "VGA_SRAM_interface:VGA_unit"
57. Port Connectivity Checks: "UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX"
58. Port Connectivity Checks: "UART_SRAM_interface:UART_unit"
59. Port Connectivity Checks: "PB_Controller:PB_unit"
60. Port Connectivity Checks: "Milestone_2:M2_unit|dual_port_RAM2:dual_port_RAM_inst2"
61. Port Connectivity Checks: "Milestone_2:M2_unit|dual_port_RAM1:dual_port_RAM_inst1"
62. Port Connectivity Checks: "Milestone_2:M2_unit|dual_port_RAM0:dual_port_RAM_inst0"
63. Port Connectivity Checks: "Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS"
64. Port Connectivity Checks: "Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT"
65. Port Connectivity Checks: "Milestone_2:M2_unit|FS:FS_unit"
66. Port Connectivity Checks: "Milestone_2:M2_unit|Milestone_3:M3_unit|dual_port_RAM3:dual_port_RAM_inst3"
67. Port Connectivity Checks: "Milestone_2:M2_unit|Milestone_3:M3_unit"
68. Port Connectivity Checks: "Milestone_2:M2_unit|WS:WS_unit"
69. Elapsed Time Per Partition
70. Analysis & Synthesis Messages
71. Analysis & Synthesis Suppressed Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2013 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
(including device programming or simulation files), and any
associated documentation or information are expressly subject
to the terms and conditions of the Altera Program License
Subscription Agreement, Altera MegaCore Function License
Agreement, or other applicable license agreement, including,
without limitation, that your use is for the sole purpose of
programming logic devices manufactured by Altera and sold by
Altera or its authorized distributors. Please refer to the
applicable agreement for further details.
+--------------------------------------------------------------------------------------+
; Analysis & Synthesis Summary ;
+------------------------------------+-------------------------------------------------+
; Analysis & Synthesis Status ; Successful - Mon Nov 26 11:05:19 2018 ;
; Quartus II 64-Bit Version ; 13.0.1 Build 232 06/12/2013 SP 1 SJ Web Edition ;
; Revision Name ; PROJECT ;
; Top-level Entity Name ; PROJECT ;
; Family ; Cyclone II ;
; Total logic elements ; 3,669 ;
; Total combinational functions ; 3,450 ;
; Dedicated logic registers ; 1,537 ;
; Total registers ; 1537 ;
; Total pins ; 165 ;
; Total virtual pins ; 0 ;
; Total memory bits ; 14,336 ;
; Embedded Multiplier 9-bit elements ; 41 ;
; Total PLLs ; 1 ;
+------------------------------------+-------------------------------------------------+
+----------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Settings ;
+----------------------------------------------------------------------------+--------------------+--------------------+
; Option ; Setting ; Default Value ;
+----------------------------------------------------------------------------+--------------------+--------------------+
; Device ; EP2C35F672C6 ; ;
; Top-level entity name ; PROJECT ; PROJECT ;
; Family name ; Cyclone II ; Cyclone IV GX ;
; Verilog Show LMF Mapping Messages ; Off ; ;
; Verilog Version ; SystemVerilog_2005 ; Verilog_2001 ;
; Use smart compilation ; Off ; Off ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On ; On ;
; Enable compact report table ; Off ; Off ;
; Restructure Multiplexers ; Auto ; Auto ;
; Create Debugging Nodes for IP Cores ; Off ; Off ;
; Preserve fewer node names ; On ; On ;
; Disable OpenCore Plus hardware evaluation ; Off ; Off ;
; VHDL Version ; VHDL_1993 ; VHDL_1993 ;
; State Machine Processing ; Auto ; Auto ;
; Safe State Machine ; Off ; Off ;
; Extract Verilog State Machines ; On ; On ;
; Extract VHDL State Machines ; On ; On ;
; Ignore Verilog initial constructs ; Off ; Off ;
; Iteration limit for constant Verilog loops ; 5000 ; 5000 ;
; Iteration limit for non-constant Verilog loops ; 250 ; 250 ;
; Add Pass-Through Logic to Inferred RAMs ; On ; On ;
; Infer RAMs from Raw Logic ; On ; On ;
; Parallel Synthesis ; On ; On ;
; DSP Block Balancing ; Auto ; Auto ;
; NOT Gate Push-Back ; On ; On ;
; Power-Up Don't Care ; On ; On ;
; Remove Redundant Logic Cells ; Off ; Off ;
; Remove Duplicate Registers ; On ; On ;
; Ignore CARRY Buffers ; Off ; Off ;
; Ignore CASCADE Buffers ; Off ; Off ;
; Ignore GLOBAL Buffers ; Off ; Off ;
; Ignore ROW GLOBAL Buffers ; Off ; Off ;
; Ignore LCELL Buffers ; Off ; Off ;
; Ignore SOFT Buffers ; On ; On ;
; Limit AHDL Integers to 32 Bits ; Off ; Off ;
; Optimization Technique ; Balanced ; Balanced ;
; Carry Chain Length ; 70 ; 70 ;
; Auto Carry Chains ; On ; On ;
; Auto Open-Drain Pins ; On ; On ;
; Perform WYSIWYG Primitive Resynthesis ; Off ; Off ;
; Auto ROM Replacement ; On ; On ;
; Auto RAM Replacement ; On ; On ;
; Auto Shift Register Replacement ; Auto ; Auto ;
; Allow Shift Register Merging across Hierarchies ; Auto ; Auto ;
; Auto Clock Enable Replacement ; On ; On ;
; Strict RAM Replacement ; Off ; Off ;
; Allow Synchronous Control Signals ; On ; On ;
; Force Use of Synchronous Clear Signals ; Off ; Off ;
; Auto RAM to Logic Cell Conversion ; Off ; Off ;
; Auto Resource Sharing ; Off ; Off ;
; Allow Any RAM Size For Recognition ; Off ; Off ;
; Allow Any ROM Size For Recognition ; Off ; Off ;
; Allow Any Shift Register Size For Recognition ; Off ; Off ;
; Use LogicLock Constraints during Resource Balancing ; On ; On ;
; Ignore translate_off and synthesis_off directives ; Off ; Off ;
; Timing-Driven Synthesis ; Off ; Off ;
; Report Parameter Settings ; On ; On ;
; Report Source Assignments ; On ; On ;
; Report Connectivity Checks ; On ; On ;
; Ignore Maximum Fan-Out Assignments ; Off ; Off ;
; Synchronization Register Chain Length ; 2 ; 2 ;
; PowerPlay Power Optimization ; Normal compilation ; Normal compilation ;
; HDL message level ; Level2 ; Level2 ;
; Suppress Register Optimization Related Messages ; Off ; Off ;
; Number of Removed Registers Reported in Synthesis Report ; 5000 ; 5000 ;
; Number of Swept Nodes Reported in Synthesis Report ; 5000 ; 5000 ;
; Number of Inverted Registers Reported in Synthesis Report ; 100 ; 100 ;
; Clock MUX Protection ; On ; On ;
; Auto Gated Clock Conversion ; Off ; Off ;
; Block Design Naming ; Auto ; Auto ;
; SDC constraint protection ; Off ; Off ;
; Synthesis Effort ; Auto ; Auto ;
; Shift Register Replacement - Allow Asynchronous Clear Signal ; On ; On ;
; Pre-Mapping Resynthesis Optimization ; Off ; Off ;
; Analysis & Synthesis Message Level ; Medium ; Medium ;
; Disable Register Merging Across Hierarchies ; Auto ; Auto ;
; Resource Aware Inference For Block RAM ; On ; On ;
; Synthesis Seed ; 1 ; 1 ;
+----------------------------------------------------------------------------+--------------------+--------------------+
Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation ;
+----------------------------+--------+
; Processors ; Number ;
+----------------------------+--------+
; Number detected on machine ; 4 ;
; Maximum allowed ; 1 ;
+----------------------------+--------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Source Files Read ;
+----------------------------------+-----------------+----------------------------------------+----------------------------------------------------------------------------+---------+
; File Name with User-Entered Path ; Used in Netlist ; File Type ; File Name with Absolute Path ; Library ;
+----------------------------------+-----------------+----------------------------------------+----------------------------------------------------------------------------+---------+
; PROJECT.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/PROJECT.v ; ;
; Milestone_3.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/Milestone_3.v ; ;
; Milestone_2.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/Milestone_2.v ; ;
; FS.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/FS.v ; ;
; MATRIX_MULTIPLIER.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/MATRIX_MULTIPLIER.v ; ;
; WS.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/WS.v ; ;
; Milestone_1.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/Milestone_1.v ; ;
; FIR.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/FIR.v ; ;
; RGB_Converter.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/RGB_Converter.v ; ;
; Clock_100_PLL.v ; yes ; User Wizard-Generated File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/Clock_100_PLL.v ; ;
; SRAM_Controller.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/SRAM_Controller.v ; ;
; PB_Controller.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/PB_Controller.v ; ;
; UART_Receive_Controller.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/UART_Receive_Controller.v ; ;
; UART_SRAM_interface.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/UART_SRAM_interface.v ; ;
; VGA_Controller.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/VGA_Controller.v ; ;
; VGA_SRAM_interface.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/VGA_SRAM_interface.v ; ;
; convert_hex_to_seven_segment.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/convert_hex_to_seven_segment.v ; ;
; dual_port_RAM0.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/dual_port_RAM0.v ; ;
; dual_port_RAM1.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/dual_port_RAM1.v ; ;
; dual_port_RAM2.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/dual_port_RAM2.v ; ;
; dual_port_RAM3.v ; yes ; User Verilog HDL File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/dual_port_RAM3.v ; ;
; VGA_Param.h ; yes ; User Unspecified File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/VGA_Param.h ; ;
; define_state.h ; yes ; User Unspecified File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/define_state.h ; ;
; altsyncram.tdf ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/altsyncram.tdf ; ;
; stratix_ram_block.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/stratix_ram_block.inc ; ;
; lpm_mux.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/lpm_mux.inc ; ;
; lpm_decode.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/lpm_decode.inc ; ;
; aglobal130.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/aglobal130.inc ; ;
; a_rdenreg.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/a_rdenreg.inc ; ;
; altrom.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/altrom.inc ; ;
; altram.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/altram.inc ; ;
; altdpram.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/altdpram.inc ; ;
; db/altsyncram_0r92.tdf ; yes ; Auto-Generated Megafunction ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/db/altsyncram_0r92.tdf ; ;
; dual_port_ram3.hex ; yes ; Auto-Found Memory Initialization File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/dual_port_ram3.hex ; ;
; db/altsyncram_tq92.tdf ; yes ; Auto-Generated Megafunction ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/db/altsyncram_tq92.tdf ; ;
; dual_port_ram0.hex ; yes ; Auto-Found Memory Initialization File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/dual_port_ram0.hex ; ;
; db/altsyncram_uq92.tdf ; yes ; Auto-Generated Megafunction ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/db/altsyncram_uq92.tdf ; ;
; dual_port_ram1.hex ; yes ; Auto-Found Memory Initialization File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/dual_port_ram1.hex ; ;
; db/altsyncram_vq92.tdf ; yes ; Auto-Generated Megafunction ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/db/altsyncram_vq92.tdf ; ;
; dual_port_ram2.hex ; yes ; Auto-Found Memory Initialization File ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/dual_port_ram2.hex ; ;
; altpll.tdf ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/altpll.tdf ; ;
; stratix_pll.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/stratix_pll.inc ; ;
; stratixii_pll.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/stratixii_pll.inc ; ;
; cycloneii_pll.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/cycloneii_pll.inc ; ;
; lpm_mult.tdf ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/lpm_mult.tdf ; ;
; lpm_add_sub.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/lpm_add_sub.inc ; ;
; multcore.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/multcore.inc ; ;
; bypassff.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/bypassff.inc ; ;
; altshift.inc ; yes ; Megafunction ; c:/altera/13.0sp1/quartus/libraries/megafunctions/altshift.inc ; ;
; db/mult_k8t.tdf ; yes ; Auto-Generated Megafunction ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/db/mult_k8t.tdf ; ;
; db/mult_r8t.tdf ; yes ; Auto-Generated Megafunction ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/db/mult_r8t.tdf ; ;
; db/mult_m1t.tdf ; yes ; Auto-Generated Megafunction ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/db/mult_m1t.tdf ; ;
; db/mult_q5t.tdf ; yes ; Auto-Generated Megafunction ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/db/mult_q5t.tdf ; ;
; db/mult_n1t.tdf ; yes ; Auto-Generated Megafunction ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/db/mult_n1t.tdf ; ;
+----------------------------------+-----------------+----------------------------------------+----------------------------------------------------------------------------+---------+
+----------------------------------------------------------+
; Analysis & Synthesis Resource Usage Summary ;
+---------------------------------------------+------------+
; Resource ; Usage ;
+---------------------------------------------+------------+
; Estimated Total logic elements ; 3,669 ;
; ; ;
; Total combinational functions ; 3450 ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 1262 ;
; -- 3 input functions ; 1287 ;
; -- <=2 input functions ; 901 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 2565 ;
; -- arithmetic mode ; 885 ;
; ; ;
; Total registers ; 1537 ;
; -- Dedicated logic registers ; 1537 ;
; -- I/O registers ; 0 ;
; ; ;
; I/O pins ; 165 ;
; Total memory bits ; 14336 ;
; Embedded Multiplier 9-bit elements ; 41 ;
; Total PLLs ; 1 ;
; -- PLLs ; 1 ;
; ; ;
; Maximum fan-out node ; CLOCK_50_I ;
; Maximum fan-out ; 1651 ;
; Total fan-out ; 19008 ;
; Average fan-out ; 3.58 ;
+---------------------------------------------+------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity ;
+-------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+----------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node ; LC Combinationals ; LC Registers ; Memory Bits ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; Full Hierarchy Name ; Library Name ;
+-------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+----------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
; |PROJECT ; 3450 (87) ; 1537 (10) ; 14336 ; 41 ; 1 ; 20 ; 165 ; 0 ; |PROJECT ; work ;
; |Milestone_1:M1_unit| ; 905 (359) ; 535 (232) ; 0 ; 9 ; 1 ; 4 ; 0 ; 0 ; |PROJECT|Milestone_1:M1_unit ; work ;
; |FIR:FIR_unit| ; 310 (310) ; 212 (212) ; 0 ; 1 ; 1 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit ; work ;
; |lpm_mult:Mult0| ; 0 (0) ; 0 (0) ; 0 ; 1 ; 1 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit|lpm_mult:Mult0 ; work ;
; |mult_q5t:auto_generated| ; 0 (0) ; 0 (0) ; 0 ; 1 ; 1 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit|lpm_mult:Mult0|mult_q5t:auto_generated ; work ;
; |RGB_Converter:RGB_unit| ; 236 (208) ; 91 (91) ; 0 ; 8 ; 0 ; 4 ; 0 ; 0 ; |PROJECT|Milestone_1:M1_unit|RGB_Converter:RGB_unit ; work ;
; |lpm_mult:Mult0| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_1:M1_unit|RGB_Converter:RGB_unit|lpm_mult:Mult0 ; work ;
; |mult_k8t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_1:M1_unit|RGB_Converter:RGB_unit|lpm_mult:Mult0|mult_k8t:auto_generated ; work ;
; |lpm_mult:Mult1| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_1:M1_unit|RGB_Converter:RGB_unit|lpm_mult:Mult1 ; work ;
; |mult_r8t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_1:M1_unit|RGB_Converter:RGB_unit|lpm_mult:Mult1|mult_r8t:auto_generated ; work ;
; |Milestone_2:M2_unit| ; 2135 (329) ; 758 (11) ; 14336 ; 32 ; 0 ; 16 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit ; work ;
; |MATRIX_MULTIPLIER:MM_unit_CS| ; 397 (341) ; 245 (245) ; 0 ; 16 ; 0 ; 8 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS ; work ;
; |lpm_mult:Mult0| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult0 ; work ;
; |mult_m1t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult0|mult_m1t:auto_generated ; work ;
; |lpm_mult:Mult1| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult1 ; work ;
; |mult_m1t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult1|mult_m1t:auto_generated ; work ;
; |lpm_mult:Mult2| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult2 ; work ;
; |mult_m1t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult2|mult_m1t:auto_generated ; work ;
; |lpm_mult:Mult3| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult3 ; work ;
; |mult_m1t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|lpm_mult:Mult3|mult_m1t:auto_generated ; work ;
; |MATRIX_MULTIPLIER:MM_unit_CT| ; 413 (357) ; 284 (284) ; 0 ; 16 ; 0 ; 8 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT ; work ;
; |lpm_mult:Mult0| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult0 ; work ;
; |mult_n1t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult0|mult_n1t:auto_generated ; work ;
; |lpm_mult:Mult1| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult1 ; work ;
; |mult_n1t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult1|mult_n1t:auto_generated ; work ;
; |lpm_mult:Mult2| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult2 ; work ;
; |mult_n1t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult2|mult_n1t:auto_generated ; work ;
; |lpm_mult:Mult3| ; 14 (0) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult3 ; work ;
; |mult_n1t:auto_generated| ; 14 (14) ; 0 (0) ; 0 ; 4 ; 0 ; 2 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|lpm_mult:Mult3|mult_n1t:auto_generated ; work ;
; |Milestone_3:M3_unit| ; 842 (842) ; 139 (139) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|Milestone_3:M3_unit ; work ;
; |dual_port_RAM3:dual_port_RAM_inst3| ; 0 (0) ; 0 (0) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|Milestone_3:M3_unit|dual_port_RAM3:dual_port_RAM_inst3 ; work ;
; |altsyncram:altsyncram_component| ; 0 (0) ; 0 (0) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|Milestone_3:M3_unit|dual_port_RAM3:dual_port_RAM_inst3|altsyncram:altsyncram_component ; work ;
; |altsyncram_0r92:auto_generated| ; 0 (0) ; 0 (0) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|Milestone_3:M3_unit|dual_port_RAM3:dual_port_RAM_inst3|altsyncram:altsyncram_component|altsyncram_0r92:auto_generated ; work ;
; |WS:WS_unit| ; 154 (154) ; 79 (79) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|WS:WS_unit ; work ;
; |dual_port_RAM0:dual_port_RAM_inst0| ; 0 (0) ; 0 (0) ; 2048 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|dual_port_RAM0:dual_port_RAM_inst0 ; work ;
; |altsyncram:altsyncram_component| ; 0 (0) ; 0 (0) ; 2048 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|dual_port_RAM0:dual_port_RAM_inst0|altsyncram:altsyncram_component ; work ;
; |altsyncram_tq92:auto_generated| ; 0 (0) ; 0 (0) ; 2048 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|dual_port_RAM0:dual_port_RAM_inst0|altsyncram:altsyncram_component|altsyncram_tq92:auto_generated ; work ;
; |dual_port_RAM1:dual_port_RAM_inst1| ; 0 (0) ; 0 (0) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|dual_port_RAM1:dual_port_RAM_inst1 ; work ;
; |altsyncram:altsyncram_component| ; 0 (0) ; 0 (0) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|dual_port_RAM1:dual_port_RAM_inst1|altsyncram:altsyncram_component ; work ;
; |altsyncram_uq92:auto_generated| ; 0 (0) ; 0 (0) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|dual_port_RAM1:dual_port_RAM_inst1|altsyncram:altsyncram_component|altsyncram_uq92:auto_generated ; work ;
; |dual_port_RAM2:dual_port_RAM_inst2| ; 0 (0) ; 0 (0) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|dual_port_RAM2:dual_port_RAM_inst2 ; work ;
; |altsyncram:altsyncram_component| ; 0 (0) ; 0 (0) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|dual_port_RAM2:dual_port_RAM_inst2|altsyncram:altsyncram_component ; work ;
; |altsyncram_vq92:auto_generated| ; 0 (0) ; 0 (0) ; 4096 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|Milestone_2:M2_unit|dual_port_RAM2:dual_port_RAM_inst2|altsyncram:altsyncram_component|altsyncram_vq92:auto_generated ; work ;
; |SRAM_Controller:SRAM_unit| ; 17 (17) ; 53 (53) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|SRAM_Controller:SRAM_unit ; work ;
; |Clock_100_PLL:Clock_100_PLL_inst| ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|SRAM_Controller:SRAM_unit|Clock_100_PLL:Clock_100_PLL_inst ; work ;
; |altpll:altpll_component| ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|SRAM_Controller:SRAM_unit|Clock_100_PLL:Clock_100_PLL_inst|altpll:altpll_component ; work ;
; |UART_SRAM_interface:UART_unit| ; 37 (36) ; 27 (26) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|UART_SRAM_interface:UART_unit ; work ;
; |UART_Receive_Controller:UART_RX| ; 1 (1) ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX ; work ;
; |VGA_SRAM_interface:VGA_unit| ; 217 (138) ; 154 (101) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|VGA_SRAM_interface:VGA_unit ; work ;
; |VGA_Controller:VGA_unit| ; 79 (79) ; 53 (53) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|VGA_SRAM_interface:VGA_unit|VGA_Controller:VGA_unit ; work ;
; |convert_hex_to_seven_segment:unit0| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|convert_hex_to_seven_segment:unit0 ; work ;
; |convert_hex_to_seven_segment:unit1| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|convert_hex_to_seven_segment:unit1 ; work ;
; |convert_hex_to_seven_segment:unit2| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|convert_hex_to_seven_segment:unit2 ; work ;
; |convert_hex_to_seven_segment:unit3| ; 3 (3) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|convert_hex_to_seven_segment:unit3 ; work ;
; |convert_hex_to_seven_segment:unit4| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|convert_hex_to_seven_segment:unit4 ; work ;
; |convert_hex_to_seven_segment:unit5| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|convert_hex_to_seven_segment:unit5 ; work ;
; |convert_hex_to_seven_segment:unit6| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|convert_hex_to_seven_segment:unit6 ; work ;
; |convert_hex_to_seven_segment:unit7| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |PROJECT|convert_hex_to_seven_segment:unit7 ; work ;
+-------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+----------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis RAM Summary ;
+------------------------------------------------------------------------------------------------------------------------------------------------------+------+----------------+--------------+--------------+--------------+--------------+------+--------------------+
; Name ; Type ; Mode ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Size ; MIF ;
+------------------------------------------------------------------------------------------------------------------------------------------------------+------+----------------+--------------+--------------+--------------+--------------+------+--------------------+
; Milestone_2:M2_unit|Milestone_3:M3_unit|dual_port_RAM3:dual_port_RAM_inst3|altsyncram:altsyncram_component|altsyncram_0r92:auto_generated|ALTSYNCRAM ; AUTO ; True Dual Port ; 128 ; 32 ; 128 ; 32 ; 4096 ; dual_port_RAM3.hex ;
; Milestone_2:M2_unit|dual_port_RAM0:dual_port_RAM_inst0|altsyncram:altsyncram_component|altsyncram_tq92:auto_generated|ALTSYNCRAM ; AUTO ; True Dual Port ; 128 ; 32 ; 128 ; 32 ; 4096 ; dual_port_RAM0.hex ;
; Milestone_2:M2_unit|dual_port_RAM1:dual_port_RAM_inst1|altsyncram:altsyncram_component|altsyncram_uq92:auto_generated|ALTSYNCRAM ; AUTO ; True Dual Port ; 128 ; 32 ; 128 ; 32 ; 4096 ; dual_port_RAM1.hex ;
; Milestone_2:M2_unit|dual_port_RAM2:dual_port_RAM_inst2|altsyncram:altsyncram_component|altsyncram_vq92:auto_generated|ALTSYNCRAM ; AUTO ; True Dual Port ; 128 ; 32 ; 128 ; 32 ; 4096 ; dual_port_RAM2.hex ;
+------------------------------------------------------------------------------------------------------------------------------------------------------+------+----------------+--------------+--------------+--------------+--------------+------+--------------------+
+-----------------------------------------------------+
; Analysis & Synthesis DSP Block Usage Summary ;
+---------------------------------------+-------------+
; Statistic ; Number Used ;
+---------------------------------------+-------------+
; Simple Multipliers (9-bit) ; 1 ;
; Simple Multipliers (18-bit) ; 20 ;
; Embedded Multiplier Blocks ; -- ;
; Embedded Multiplier 9-bit elements ; 41 ;
; Signed Embedded Multipliers ; 8 ;
; Unsigned Embedded Multipliers ; 5 ;
; Mixed Sign Embedded Multipliers ; 8 ;
; Variable Sign Embedded Multipliers ; 0 ;
; Dedicated Input Shift Register Chains ; 0 ;
+---------------------------------------+-------------+
Note: number of Embedded Multiplier Blocks used is only available after a successful fit.
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis IP Cores Summary ;
+--------+--------------+---------+--------------+--------------+---------------------------------------------------------------------+-------------------------------------------------------------+
; Vendor ; IP Core Name ; Version ; Release Date ; License Type ; Entity Instance ; IP Include File ;
+--------+--------------+---------+--------------+--------------+---------------------------------------------------------------------+-------------------------------------------------------------+
; Altera ; ALTPLL ; N/A ; N/A ; N/A ; |PROJECT|SRAM_Controller:SRAM_unit|Clock_100_PLL:Clock_100_PLL_inst ; C:/Users/sstje/Desktop/3DQ5_PROJECT/PROJECT/Clock_100_PLL.v ;
+--------+--------------+---------+--------------+--------------+---------------------------------------------------------------------+-------------------------------------------------------------+
Encoding Type: One-Hot
+----------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|UART_state ;
+-----------------------------+------------------------+---------------------------+-----------------------------+
; Name ; UART_state.S_UART_IDLE ; UART_state.S_WAIT_UART_RX ; UART_state.S_ENABLE_UART_RX ;
+-----------------------------+------------------------+---------------------------+-----------------------------+
; UART_state.S_UART_IDLE ; 0 ; 0 ; 0 ;
; UART_state.S_ENABLE_UART_RX ; 1 ; 0 ; 1 ;
; UART_state.S_WAIT_UART_RX ; 1 ; 1 ; 0 ;
+-----------------------------+------------------------+---------------------------+-----------------------------+
Encoding Type: One-Hot
+------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|state ;
+------------------+----------------+------------------+-----------------+------------------+----------------+
; Name ; state.S_TOP_M1 ; state.S_TOP_UART ; state.S_TOP_VGA ; state.S_TOP_IDLE ; state.S_TOP_M2 ;
+------------------+----------------+------------------+-----------------+------------------+----------------+
; state.S_TOP_IDLE ; 0 ; 0 ; 0 ; 0 ; 0 ;
; state.S_TOP_VGA ; 0 ; 0 ; 1 ; 1 ; 0 ;
; state.S_TOP_UART ; 0 ; 1 ; 0 ; 1 ; 0 ;
; state.S_TOP_M1 ; 1 ; 0 ; 0 ; 1 ; 0 ;
; state.S_TOP_M2 ; 0 ; 0 ; 0 ; 1 ; 1 ;
+------------------+----------------+------------------+-----------------+------------------+----------------+
Encoding Type: One-Hot
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|VGA_SRAM_interface:VGA_unit|VGA_SRAM_state ;
+-------------------------------------------+----------------------------------------+----------------------------------------+----------------------------------------+----------------------------------------+-------------------------------------------+-------------------------------------------+-------------------------------------------+-------------------------------------------+-------------------------------------------+----------------------------------------+
; Name ; VGA_SRAM_state.S_VS_FETCH_PIXEL_DATA_3 ; VGA_SRAM_state.S_VS_FETCH_PIXEL_DATA_2 ; VGA_SRAM_state.S_VS_FETCH_PIXEL_DATA_1 ; VGA_SRAM_state.S_VS_FETCH_PIXEL_DATA_0 ; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_5 ; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_4 ; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_3 ; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_2 ; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_1 ; VGA_SRAM_state.S_VS_WAIT_NEW_PIXEL_ROW ;
+-------------------------------------------+----------------------------------------+----------------------------------------+----------------------------------------+----------------------------------------+-------------------------------------------+-------------------------------------------+-------------------------------------------+-------------------------------------------+-------------------------------------------+----------------------------------------+
; VGA_SRAM_state.S_VS_WAIT_NEW_PIXEL_ROW ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;
; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;
; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;
; VGA_SRAM_state.S_VS_NEW_PIXEL_ROW_DELAY_5 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; VGA_SRAM_state.S_VS_FETCH_PIXEL_DATA_0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; VGA_SRAM_state.S_VS_FETCH_PIXEL_DATA_1 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; VGA_SRAM_state.S_VS_FETCH_PIXEL_DATA_2 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; VGA_SRAM_state.S_VS_FETCH_PIXEL_DATA_3 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
+-------------------------------------------+----------------------------------------+----------------------------------------+----------------------------------------+----------------------------------------+-------------------------------------------+-------------------------------------------+-------------------------------------------+-------------------------------------------+-------------------------------------------+----------------------------------------+
Encoding Type: One-Hot
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|UART_SRAM_interface:UART_unit|UART_SRAM_state ;
+------------------------------------------------+----------------------------------------+------------------------------------------------+---------------------------------------+-----------------------------------------------+------------------------------------------+------------------------------------------+---------------------------+
; Name ; UART_SRAM_state.S_US_WRITE_SECOND_BYTE ; UART_SRAM_state.S_US_START_SECOND_BYTE_RECEIVE ; UART_SRAM_state.S_US_WRITE_FIRST_BYTE ; UART_SRAM_state.S_US_START_FIRST_BYTE_RECEIVE ; UART_SRAM_state.S_US_STRIP_FILE_HEADER_2 ; UART_SRAM_state.S_US_STRIP_FILE_HEADER_1 ; UART_SRAM_state.S_US_IDLE ;
+------------------------------------------------+----------------------------------------+------------------------------------------------+---------------------------------------+-----------------------------------------------+------------------------------------------+------------------------------------------+---------------------------+
; UART_SRAM_state.S_US_IDLE ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; UART_SRAM_state.S_US_STRIP_FILE_HEADER_1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
; UART_SRAM_state.S_US_STRIP_FILE_HEADER_2 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;
; UART_SRAM_state.S_US_START_FIRST_BYTE_RECEIVE ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;
; UART_SRAM_state.S_US_WRITE_FIRST_BYTE ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;
; UART_SRAM_state.S_US_START_SECOND_BYTE_RECEIVE ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; UART_SRAM_state.S_US_WRITE_SECOND_BYTE ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
+------------------------------------------------+----------------------------------------+------------------------------------------------+---------------------------------------+-----------------------------------------------+------------------------------------------+------------------------------------------+---------------------------+
Encoding Type: One-Hot
+----------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state ;
+-------------------------------+--------------------------+-------------------------------+----------------------+----------------------+
; Name ; RXC_state.S_RXC_STOP_BIT ; RXC_state.S_RXC_ASSEMBLE_DATA ; RXC_state.S_RXC_SYNC ; RXC_state.S_RXC_IDLE ;
+-------------------------------+--------------------------+-------------------------------+----------------------+----------------------+
; RXC_state.S_RXC_IDLE ; 0 ; 0 ; 0 ; 0 ;
; RXC_state.S_RXC_SYNC ; 0 ; 0 ; 1 ; 1 ;
; RXC_state.S_RXC_ASSEMBLE_DATA ; 0 ; 1 ; 0 ; 1 ;
; RXC_state.S_RXC_STOP_BIT ; 1 ; 0 ; 0 ; 1 ;
+-------------------------------+--------------------------+-------------------------------+----------------------+----------------------+
Encoding Type: One-Hot
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|Milestone_1:M1_unit|state ;
+----------------------+------------------+--------------------+--------------------+--------------------+--------------------+--------------------+--------------------+--------------------+--------------------+---------------+---------------+---------------+---------------+---------------+---------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+-----------------+
; Name ; state.S_M1_START ; state.S_END_LINE_7 ; state.S_END_LINE_6 ; state.S_END_LINE_5 ; state.S_END_LINE_4 ; state.S_END_LINE_3 ; state.S_END_LINE_2 ; state.S_END_LINE_1 ; state.S_END_LINE_0 ; state.S_RUN_5 ; state.S_RUN_4 ; state.S_RUN_3 ; state.S_RUN_2 ; state.S_RUN_1 ; state.S_RUN_0 ; state.S_START_LINE_9 ; state.S_START_LINE_8 ; state.S_START_LINE_7 ; state.S_START_LINE_6 ; state.S_START_LINE_5 ; state.S_START_LINE_4 ; state.S_START_LINE_3 ; state.S_START_LINE_2 ; state.S_START_LINE_1 ; state.S_START_LINE_0 ; state.S_M1_IDLE ;
+----------------------+------------------+--------------------+--------------------+--------------------+--------------------+--------------------+--------------------+--------------------+--------------------+---------------+---------------+---------------+---------------+---------------+---------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+-----------------+
; state.S_M1_IDLE ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; state.S_START_LINE_0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
; state.S_START_LINE_1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;
; state.S_START_LINE_2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;
; state.S_START_LINE_3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;
; state.S_START_LINE_4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_START_LINE_5 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_START_LINE_6 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_START_LINE_7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_START_LINE_8 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_START_LINE_9 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_RUN_0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_RUN_1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_RUN_2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_RUN_3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_RUN_4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_RUN_5 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_END_LINE_0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_END_LINE_1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_END_LINE_2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_END_LINE_3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_END_LINE_4 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_END_LINE_5 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_END_LINE_6 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_END_LINE_7 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M1_START ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
+----------------------+------------------+--------------------+--------------------+--------------------+--------------------+--------------------+--------------------+--------------------+--------------------+---------------+---------------+---------------+---------------+---------------+---------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+----------------------+-----------------+
Encoding Type: One-Hot
+---------------------------------------------------------------------------------+
; State Machine - |PROJECT|Milestone_1:M1_unit|RGB_Converter:RGB_unit|sel_rgb_mul ;
+----------------+----------------+----------------+------------------------------+
; Name ; sel_rgb_mul.00 ; sel_rgb_mul.10 ; sel_rgb_mul.01 ;
+----------------+----------------+----------------+------------------------------+
; sel_rgb_mul.00 ; 0 ; 0 ; 0 ;
; sel_rgb_mul.01 ; 1 ; 0 ; 1 ;
; sel_rgb_mul.10 ; 1 ; 1 ; 0 ;
+----------------+----------------+----------------+------------------------------+
Encoding Type: One-Hot
+----------------------------------------------------------------------+
; State Machine - |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit|sel_mul_in ;
+---------------+---------------+---------------+----------------------+
; Name ; sel_mul_in.11 ; sel_mul_in.01 ; sel_mul_in.10 ;
+---------------+---------------+---------------+----------------------+
; sel_mul_in.01 ; 0 ; 0 ; 0 ;
; sel_mul_in.10 ; 0 ; 1 ; 1 ;
; sel_mul_in.11 ; 1 ; 1 ; 0 ;
+---------------+---------------+---------------+----------------------+
Encoding Type: One-Hot
+-----------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|Milestone_2:M2_unit|state ;
+------------------+------------------+------------+------------+------------+------------+-----------------+
; Name ; state.S_M2_START ; state.S_WS ; state.S_CS ; state.S_CT ; state.S_FS ; state.S_M2_IDLE ;
+------------------+------------------+------------+------------+------------+------------+-----------------+
; state.S_M2_IDLE ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; state.S_FS ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
; state.S_CT ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;
; state.S_CS ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;
; state.S_WS ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M2_START ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;
+------------------+------------------+------------+------------+------------+------------+-----------------+
Encoding Type: One-Hot
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state ;
+------------------+-----------------+-----------------+-----------------+---------------+-----------------+-----------------+-----------------+------------------+
; Name ; state.S_MM_LO_2 ; state.S_MM_LO_1 ; state.S_MM_LO_0 ; state.S_MM_CC ; state.S_MM_LI_1 ; state.S_MM_LI_0 ; state.S_MM_IDLE ; state.S_MM_START ;
+------------------+-----------------+-----------------+-----------------+---------------+-----------------+-----------------+-----------------+------------------+
; state.S_MM_START ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; state.S_MM_IDLE ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
; state.S_MM_LI_0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;
; state.S_MM_LI_1 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;
; state.S_MM_CC ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;
; state.S_MM_LO_0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_MM_LO_1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_MM_LO_2 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
+------------------+-----------------+-----------------+-----------------+---------------+-----------------+-----------------+-----------------+------------------+
Encoding Type: One-Hot
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|state ;
+------------------+-----------------+-----------------+-----------------+---------------+-----------------+-----------------+-----------------+------------------+
; Name ; state.S_MM_LO_2 ; state.S_MM_LO_1 ; state.S_MM_LO_0 ; state.S_MM_CC ; state.S_MM_LI_1 ; state.S_MM_LI_0 ; state.S_MM_IDLE ; state.S_MM_START ;
+------------------+-----------------+-----------------+-----------------+---------------+-----------------+-----------------+-----------------+------------------+
; state.S_MM_START ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; state.S_MM_IDLE ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
; state.S_MM_LI_0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;
; state.S_MM_LI_1 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;
; state.S_MM_CC ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;
; state.S_MM_LO_0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_MM_LO_1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_MM_LO_2 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
+------------------+-----------------+-----------------+-----------------+---------------+-----------------+-----------------+-----------------+------------------+
Encoding Type: One-Hot
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|Milestone_2:M2_unit|FS:FS_unit|state ;
+------------------------+-----------------+-----------------+------------------------+-----------------+-----------------+-----------------+-----------------+------------------+-----------------+
; Name ; state.S_FS_LO_2 ; state.S_FS_LO_1 ; state.S_FS_COMMON_CASE ; state.S_FS_LI_3 ; state.S_FS_LI_2 ; state.S_FS_LI_1 ; state.S_FS_IDLE ; state.S_FS_START ; state.S_FS_LO_3 ;
+------------------------+-----------------+-----------------+------------------------+-----------------+-----------------+-----------------+-----------------+------------------+-----------------+
; state.S_FS_START ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; state.S_FS_IDLE ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ; 0 ;
; state.S_FS_LI_1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ; 0 ;
; state.S_FS_LI_2 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ; 0 ;
; state.S_FS_LI_3 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ; 0 ;
; state.S_FS_COMMON_CASE ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ;
; state.S_FS_LO_1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ;
; state.S_FS_LO_2 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ;
; state.S_FS_LO_3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
+------------------------+-----------------+-----------------+------------------------+-----------------+-----------------+-----------------+-----------------+------------------+-----------------+
Encoding Type: One-Hot
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|Milestone_2:M2_unit|Milestone_3:M3_unit|state ;
+-------------------------+-----------------+------------------------+-------------------------+------------------+---------------+-----------------+-----------------+-----------------+-----------------+-----------------+-----------------+------------------------+-----------------------+----------------------+----------------------+------------------+------------------+------------------+------------------+
; Name ; state.S_M3_IDLE ; state.S_M3_WRITE_ZEROS ; state.S_M3_ZEROS_TO_END ; state.S_M3_3_bit ; state.S_M3_CC ; state.S_M3_LI_6 ; state.S_M3_LI_5 ; state.S_M3_LI_4 ; state.S_M3_LI_3 ; state.S_M3_LI_2 ; state.S_M3_LI_1 ; state.S_M3_READ_HEIGHT ; state.S_M3_READ_WIDTH ; state.S_M3_READ_BEEF ; state.S_M3_READ_DEAD ; state.S_M3_LI_H3 ; state.S_M3_LI_H2 ; state.S_M3_LI_H1 ; state.S_M3_START ;
+-------------------------+-----------------+------------------------+-------------------------+------------------+---------------+-----------------+-----------------+-----------------+-----------------+-----------------+-----------------+------------------------+-----------------------+----------------------+----------------------+------------------+------------------+------------------+------------------+
; state.S_M3_START ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; state.S_M3_LI_H1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
; state.S_M3_LI_H2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;
; state.S_M3_LI_H3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;
; state.S_M3_READ_DEAD ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_READ_BEEF ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_READ_WIDTH ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_READ_HEIGHT ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_LI_1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_LI_2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_LI_3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_LI_4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_LI_5 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_LI_6 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_CC ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_3_bit ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_ZEROS_TO_END ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_WRITE_ZEROS ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_M3_IDLE ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
+-------------------------+-----------------+------------------------+-------------------------+------------------+---------------+-----------------+-----------------+-----------------+-----------------+-----------------+-----------------+------------------------+-----------------------+----------------------+----------------------+------------------+------------------+------------------+------------------+
Encoding Type: One-Hot
+--------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |PROJECT|Milestone_2:M2_unit|WS:WS_unit|state ;
+------------------------+-----------------+-----------------+------------------------+-----------------+-----------------+-----------------+------------------+
; Name ; state.S_WS_LO_2 ; state.S_WS_LO_1 ; state.S_WS_COMMON_CASE ; state.S_WS_LI_2 ; state.S_WS_LI_1 ; state.S_WS_IDLE ; state.S_WS_START ;
+------------------------+-----------------+-----------------+------------------------+-----------------+-----------------+-----------------+------------------+
; state.S_WS_START ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; state.S_WS_IDLE ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
; state.S_WS_LI_1 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;
; state.S_WS_LI_2 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;
; state.S_WS_COMMON_CASE ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;
; state.S_WS_LO_1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;
; state.S_WS_LO_2 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;
+------------------------+-----------------+-----------------+------------------------+-----------------+-----------------+-----------------+------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Registers Removed During Synthesis ;
+---------------------------------------------------------------------------------------------+-------------------------------------------------------------------------------+
; Register name ; Reason for Removal ;
+---------------------------------------------------------------------------------------------+-------------------------------------------------------------------------------+
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[3][15] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[3][14] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[3][13] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[3][12] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[3][11] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[3][10] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[3][9] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[3][8] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[2][15] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[2][14] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[2][13] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[2][12] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[2][11] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[2][10] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[2][9] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[2][8] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[1][15] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[1][14] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[1][13] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[1][12] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[1][11] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[1][10] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[1][9] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[1][8] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[0][15] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[0][14] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[0][13] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[0][12] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[0][11] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[0][10] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[0][9] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|product_out[0][8] ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|P_write_data[0..7,24..31] ; Lost fanout ;
; Milestone_1:M1_unit|Y_compare_address[0..4] ; Stuck at GND due to stuck port data_in ;
; Milestone_1:M1_unit|Y_buff[8..31] ; Stuck at GND due to stuck port data_in ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[31] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[31] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[30] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[30] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[29] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[29] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[28] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[28] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[27] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[27] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[26] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[26] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[25] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[25] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[24] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[24] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[23] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[23] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[22] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[22] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[21] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[21] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[20] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[20] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[19] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[19] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[18] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[18] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[17] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[17] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[16] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[16] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[15] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[15] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[14] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[14] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[13] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[13] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[12] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[12] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[11] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[11] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[10] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[10] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[9] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[9] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[8] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[8] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[7] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[7] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[6] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[6] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[5] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[5] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[4] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[4] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[3] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[3] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[2] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[2] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[1] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[1] ;
; Milestone_1:M1_unit|RGB_Converter:RGB_unit|B_acc[0] ; Merged with Milestone_1:M1_unit|RGB_Converter:RGB_unit|R_acc[0] ;
; VGA_SRAM_interface:VGA_unit|VGA_blue[1] ; Merged with VGA_SRAM_interface:VGA_unit|VGA_blue[0] ;
; VGA_SRAM_interface:VGA_unit|VGA_green[0,1] ; Merged with VGA_SRAM_interface:VGA_unit|VGA_blue[0] ;
; VGA_SRAM_interface:VGA_unit|VGA_red[0,1] ; Merged with VGA_SRAM_interface:VGA_unit|VGA_blue[0] ;
; Milestone_1:M1_unit|Y_RGB[8,9,11..31] ; Merged with Milestone_1:M1_unit|Y_RGB[10] ;
; Milestone_1:M1_unit|U_RGB[24..31] ; Merged with Milestone_1:M1_unit|U_RGB[23] ;
; Milestone_1:M1_unit|V_RGB[24..31] ; Merged with Milestone_1:M1_unit|V_RGB[23] ;
; Milestone_1:M1_unit|FIR:FIR_unit|FIR_BUFF_U[24..31] ; Merged with Milestone_1:M1_unit|FIR:FIR_unit|FIR_BUFF_U[23] ;
; Milestone_1:M1_unit|FIR:FIR_unit|FIR_BUFF_V[24..31] ; Merged with Milestone_1:M1_unit|FIR:FIR_unit|FIR_BUFF_V[23] ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|P_write_data[24..31] ; Merged with Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|P_write_data[23] ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|RAM3_write_data[15..31] ; Merged with Milestone_2:M2_unit|Milestone_3:M3_unit|RAM3_write_data[14] ;
; Milestone_2:M2_unit|WS:WS_unit|Base_address[1..7,11,16,17] ; Merged with Milestone_2:M2_unit|WS:WS_unit|Base_address[0] ;
; Milestone_2:M2_unit|WS:WS_unit|Base_address[8,14] ; Merged with Milestone_2:M2_unit|WS:WS_unit|Base_address[13] ;
; Milestone_2:M2_unit|WS:WS_unit|Base_address[9,12] ; Merged with Milestone_2:M2_unit|WS:WS_unit|Base_address[10] ;
; Milestone_2:M2_unit|WS:WS_unit|C_END[5] ; Merged with Milestone_2:M2_unit|WS:WS_unit|C_END[2] ;
; Milestone_2:M2_unit|WS:WS_unit|C_END[1] ; Merged with Milestone_2:M2_unit|WS:WS_unit|C_END[0] ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|P_write_address[6] ; Stuck at GND due to stuck port data_in ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|P_write_address[6] ; Stuck at GND due to stuck port data_in ;
; Milestone_2:M2_unit|WS:WS_unit|C_END[0] ; Stuck at VCC due to stuck port data_in ;
; Milestone_2:M2_unit|WS:WS_unit|Base_address[0] ; Stuck at GND due to stuck port data_in ;
; Milestone_2:M2_unit|WS:WS_unit|C_END[3] ; Stuck at GND due to stuck port data_in ;
; Milestone_1:M1_unit|Y_RGB[10] ; Stuck at GND due to stuck port data_in ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|RAM3_address[6] ; Stuck at GND due to stuck port data_in ;
; Milestone_2:M2_unit|WS:WS_unit|SRAM_address[17] ; Stuck at GND due to stuck port data_in ;
; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_LI_1 ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_LI_2 ; Lost fanout ;
; state~9 ; Lost fanout ;
; state~10 ; Lost fanout ;
; VGA_SRAM_interface:VGA_unit|VGA_SRAM_state~14 ; Lost fanout ;
; VGA_SRAM_interface:VGA_unit|VGA_SRAM_state~15 ; Lost fanout ;
; VGA_SRAM_interface:VGA_unit|VGA_SRAM_state~16 ; Lost fanout ;
; VGA_SRAM_interface:VGA_unit|VGA_SRAM_state~17 ; Lost fanout ;
; UART_SRAM_interface:UART_unit|UART_SRAM_state~11 ; Lost fanout ;
; UART_SRAM_interface:UART_unit|UART_SRAM_state~12 ; Lost fanout ;
; UART_SRAM_interface:UART_unit|UART_SRAM_state~13 ; Lost fanout ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state~8 ; Lost fanout ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state~9 ; Lost fanout ;
; Milestone_1:M1_unit|state~30 ; Lost fanout ;
; Milestone_1:M1_unit|state~31 ; Lost fanout ;
; Milestone_1:M1_unit|state~32 ; Lost fanout ;
; Milestone_1:M1_unit|state~33 ; Lost fanout ;
; Milestone_1:M1_unit|state~34 ; Lost fanout ;
; Milestone_2:M2_unit|state~10 ; Lost fanout ;
; Milestone_2:M2_unit|state~11 ; Lost fanout ;
; Milestone_2:M2_unit|state~12 ; Lost fanout ;
; Milestone_2:M2_unit|state~13 ; Lost fanout ;
; Milestone_2:M2_unit|state~14 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state~12 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state~13 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state~14 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state~15 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state~16 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|state~12 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|state~13 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|state~14 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|state~15 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|state~16 ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state~9 ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state~10 ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state~11 ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state~13 ; Lost fanout ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|state~23 ; Lost fanout ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|state~24 ; Lost fanout ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|state~25 ; Lost fanout ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|state~26 ; Lost fanout ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|state~27 ; Lost fanout ;
; Milestone_2:M2_unit|WS:WS_unit|state~11 ; Lost fanout ;
; Milestone_2:M2_unit|WS:WS_unit|state~12 ; Lost fanout ;
; Milestone_2:M2_unit|WS:WS_unit|state~13 ; Lost fanout ;
; Milestone_2:M2_unit|WS:WS_unit|state~14 ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_LI_3 ; Stuck at GND due to stuck port data_in ;
; Milestone_2:M2_unit|FS:FS_unit|SC[0..5] ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_LO_3 ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_START ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_IDLE ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_COMMON_CASE ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_LO_1 ; Lost fanout ;
; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_LO_2 ; Lost fanout ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|state.S_MM_START ; Merged with Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state.S_MM_START ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|state.S_M3_START ; Merged with Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state.S_MM_START ;
; Milestone_2:M2_unit|WS:WS_unit|state.S_WS_START ; Merged with Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|state.S_MM_START ;
; state.S_TOP_UART ; Stuck at GND due to stuck port data_in ;
; UART_rx_initialize ; Stuck at GND due to stuck port clock_enable ;
; UART_rx_enable ; Stuck at GND due to stuck port clock_enable ;
; UART_timer[0..25] ; Stuck at GND due to stuck port clock_enable ;
; UART_done ; Stuck at GND due to stuck port clock_enable ;
; UART_state.S_UART_IDLE ; Stuck at GND due to stuck port data_in ;
; UART_state.S_WAIT_UART_RX ; Stuck at GND due to stuck port data_in ;
; UART_state.S_ENABLE_UART_RX ; Stuck at GND due to stuck port data_in ;
; UART_SRAM_interface:UART_unit|UART_rx_enable ; Stuck at GND due to stuck port data_in ;
; VGA_enable ; Merged with state.S_TOP_VGA ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state.S_RXC_SYNC ; Stuck at GND due to stuck port data_in ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state.S_RXC_ASSEMBLE_DATA ; Stuck at GND due to stuck port data_in ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_buffer[0..7] ; Stuck at GND due to stuck port clock_enable ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data[0..7] ; Stuck at GND due to stuck port data_in ;
; UART_SRAM_interface:UART_unit|SRAM_write_data[0..15] ; Stuck at GND due to stuck port data_in ;
; UART_SRAM_interface:UART_unit|new_line_count[1] ; Stuck at GND due to stuck port clock ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_count[0..2] ; Lost fanout ;
; UART_SRAM_interface:UART_unit|new_line_count[0] ; Lost fanout ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state.S_RXC_STOP_BIT ; Stuck at GND due to stuck port data_in ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data_in ; Lost fanout ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[0..9] ; Lost fanout ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state.S_RXC_IDLE ; Lost fanout ;
; Total Number of Removed Registers = 367 ; ;
+---------------------------------------------------------------------------------------------+-------------------------------------------------------------------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Removed Registers Triggering Further Register Optimizations ;
+---------------------------------------------------------------------------+--------------------------------+----------------------------------------------------------------------------------------------+
; Register name ; Reason for Removal ; Registers Removed due to This Register ;
+---------------------------------------------------------------------------+--------------------------------+----------------------------------------------------------------------------------------------+
; state.S_TOP_UART ; Stuck at GND ; UART_rx_initialize, UART_rx_enable, UART_timer[21], UART_timer[20], UART_timer[19], ;
; ; due to stuck port data_in ; UART_timer[18], UART_timer[17], UART_timer[16], UART_timer[15], UART_timer[14], ;
; ; ; UART_timer[13], UART_timer[12], UART_timer[11], UART_timer[10], UART_timer[9], ;
; ; ; UART_timer[8], UART_timer[7], UART_timer[6], UART_timer[5], UART_timer[4], UART_timer[3], ;
; ; ; UART_timer[2], UART_timer[1], UART_timer[0], UART_done, UART_state.S_WAIT_UART_RX, ;
; ; ; UART_SRAM_interface:UART_unit|UART_rx_enable, ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state.S_RXC_SYNC, ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state.S_RXC_ASSEMBLE_DATA, ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_buffer[0], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_buffer[1], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_buffer[2], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_buffer[3], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_buffer[4], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_buffer[5], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_buffer[6], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_buffer[7], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data[0], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data[1], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data[2], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data[3], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data[4], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data[5], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data[6], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data[7], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[0], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[1], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[2], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[3], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[4], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[5], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[6], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[7], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[8], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[9], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[10], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[11], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[12], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[13], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[14], ;
; ; ; UART_SRAM_interface:UART_unit|SRAM_write_data[15], ;
; ; ; UART_SRAM_interface:UART_unit|new_line_count[1], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_count[2], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_count[1], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|data_count[0], ;
; ; ; UART_SRAM_interface:UART_unit|new_line_count[0], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state.S_RXC_STOP_BIT, ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RX_data_in, ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[0], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[1], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[2], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[3], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[4], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[5], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[7], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state.S_RXC_IDLE ;
; Milestone_2:M2_unit|FS:FS_unit|state~9 ; Lost Fanouts ; Milestone_2:M2_unit|FS:FS_unit|SC[5], Milestone_2:M2_unit|FS:FS_unit|SC[4], ;
; ; ; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_LO_3, ;
; ; ; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_START, ;
; ; ; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_IDLE, ;
; ; ; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_COMMON_CASE, ;
; ; ; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_LO_1, ;
; ; ; Milestone_2:M2_unit|FS:FS_unit|state.S_FS_LO_2 ;
; Milestone_2:M2_unit|FS:FS_unit|state~10 ; Lost Fanouts ; Milestone_2:M2_unit|FS:FS_unit|SC[3], Milestone_2:M2_unit|FS:FS_unit|SC[2], ;
; ; ; Milestone_2:M2_unit|FS:FS_unit|SC[1], Milestone_2:M2_unit|FS:FS_unit|SC[0] ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|RXC_state~8 ; Lost Fanouts ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[8], ;
; ; ; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|clock_count[9] ;
; Milestone_1:M1_unit|Y_buff[10] ; Stuck at GND ; Milestone_1:M1_unit|Y_RGB[10] ;
; ; due to stuck port data_in ; ;
; Milestone_2:M2_unit|WS:WS_unit|Base_address[0] ; Stuck at GND ; Milestone_2:M2_unit|WS:WS_unit|SRAM_address[17] ;
; ; due to stuck port data_in ; ;
; UART_timer[25] ; Stuck at GND ; UART_state.S_UART_IDLE ;
; ; due to stuck port clock_enable ; ;
+---------------------------------------------------------------------------+--------------------------------+----------------------------------------------------------------------------------------------+
+------------------------------------------------------+
; General Register Statistics ;
+----------------------------------------------+-------+
; Statistic ; Value ;
+----------------------------------------------+-------+
; Total registers ; 1537 ;
; Number of registers using Synchronous Clear ; 245 ;
; Number of registers using Synchronous Load ; 220 ;
; Number of registers using Asynchronous Clear ; 1471 ;
; Number of registers using Asynchronous Load ; 0 ;
; Number of registers using Clock Enable ; 1002 ;
; Number of registers using Preset ; 0 ;
+----------------------------------------------+-------+
+-------------------------------------------------------------------------------+
; Inverted Register Statistics ;
+---------------------------------------------------------------------+---------+
; Inverted Register ; Fan out ;
+---------------------------------------------------------------------+---------+
; Milestone_2:M2_unit|Milestone_3:M3_unit|SRAM_address[10] ; 2 ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|SRAM_address[11] ; 2 ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|SRAM_address[13] ; 2 ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|SRAM_address[16] ; 2 ;
; Milestone_1:M1_unit|U_address[8] ; 3 ;
; Milestone_1:M1_unit|RGB_address[9] ; 2 ;
; Milestone_1:M1_unit|Y_address[9] ; 4 ;
; Milestone_1:M1_unit|RGB_address[10] ; 2 ;
; Milestone_1:M1_unit|Y_address[10] ; 4 ;
; Milestone_1:M1_unit|RGB_address[11] ; 2 ;
; Milestone_1:M1_unit|RGB_address[12] ; 2 ;
; Milestone_1:M1_unit|Y_address[12] ; 4 ;
; Milestone_1:M1_unit|U_address[13] ; 3 ;
; Milestone_1:M1_unit|RGB_address[13] ; 2 ;
; Milestone_1:M1_unit|U_address[14] ; 3 ;
; Milestone_1:M1_unit|U_address[15] ; 3 ;
; Milestone_1:M1_unit|Y_address[15] ; 4 ;
; Milestone_1:M1_unit|RGB_address[17] ; 2 ;
; Milestone_1:M1_unit|SRAM_address[9] ; 1 ;
; Milestone_1:M1_unit|SRAM_address[10] ; 1 ;
; Milestone_1:M1_unit|SRAM_address[12] ; 1 ;
; Milestone_1:M1_unit|SRAM_address[15] ; 1 ;
; SRAM_Controller:SRAM_unit|SRAM_WE_N_O ; 17 ;
; SRAM_Controller:SRAM_unit|SRAM_CE_N_O ; 2 ;
; Milestone_1:M1_unit|cycle ; 24 ;
; Milestone_2:M2_unit|Milestone_3:M3_unit|first_run ; 7 ;
; UART_SRAM_interface:UART_unit|UART_Receive_Controller:UART_RX|Empty ; 11 ;
; Milestone_1:M1_unit|SRAM_we_n ; 2 ;
; Milestone_2:M2_unit|WS:WS_unit|SRAM_we_n ; 3 ;
; Milestone_2:M2_unit|WS:WS_unit|C_END[2] ; 3 ;
; Milestone_2:M2_unit|WS:WS_unit|first_run ; 2 ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|first_run ; 3 ;
; Milestone_1:M1_unit|FIR:FIR_unit|FIR_accum[7] ; 2 ;
; Milestone_1:M1_unit|line_start ; 110 ;
; Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|first_run ; 3 ;
; Total number of inverted registers = 35 ; ;
+---------------------------------------------------------------------+---------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Multiplexer Restructuring Statistics (Restructuring Performed) ;
+--------------------+-----------+---------------+----------------------+------------------------+------------+---------------------------------------------------------------------------------------+
; Multiplexer Inputs ; Bus Width ; Baseline Area ; Area if Restructured ; Saving if Restructured ; Registered ; Example Multiplexer Output ;
+--------------------+-----------+---------------+----------------------+------------------------+------------+---------------------------------------------------------------------------------------+
; 3:1 ; 8 bits ; 16 LEs ; 16 LEs ; 0 LEs ; Yes ; |PROJECT|Milestone_1:M1_unit|RGB_Converter:RGB_unit|G_buff[3] ;
; 3:1 ; 16 bits ; 32 LEs ; 16 LEs ; 16 LEs ; Yes ; |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit|V_in_buffer[1][2] ;
; 3:1 ; 16 bits ; 32 LEs ; 16 LEs ; 16 LEs ; Yes ; |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit|U_in_buffer[1][2] ;
; 3:1 ; 32 bits ; 64 LEs ; 32 LEs ; 32 LEs ; Yes ; |PROJECT|Milestone_1:M1_unit|RGB_Converter:RGB_unit|G_acc[0] ;
; 3:1 ; 14 bits ; 28 LEs ; 28 LEs ; 0 LEs ; Yes ; |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit|FIR_accum[30] ;
; 3:1 ; 17 bits ; 34 LEs ; 34 LEs ; 0 LEs ; Yes ; |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit|FIR_accum[8] ;
; 8:1 ; 16 bits ; 80 LEs ; 32 LEs ; 48 LEs ; Yes ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CS|P_write_data[9] ;
; 8:1 ; 24 bits ; 120 LEs ; 48 LEs ; 72 LEs ; Yes ; |PROJECT|Milestone_2:M2_unit|MATRIX_MULTIPLIER:MM_unit_CT|P_write_data[4] ;
; 5:1 ; 16 bits ; 48 LEs ; 32 LEs ; 16 LEs ; Yes ; |PROJECT|Milestone_1:M1_unit|FIR:FIR_unit|U_SReg[5][3] ;
; 4:1 ; 8 bits ; 16 LEs ; 8 LEs ; 8 LEs ; Yes ; |PROJECT|UART_SRAM_interface:UART_unit|SRAM_write_data[9] ;
; 4:1 ; 8 bits ; 16 LEs ; 8 LEs ; 8 LEs ; Yes ; |PROJECT|UART_SRAM_interface:UART_unit|SRAM_write_data[2] ;
; 4:1 ; 8 bits ; 16 LEs ; 8 LEs ; 8 LEs ; Yes ; |PROJECT|Milestone_1:M1_unit|B_out_buffer[6] ;
; 4:1 ; 6 bits ; 12 LEs ; 0 LEs ; 12 LEs ; Yes ; |PROJECT|Milestone_2:M2_unit|Milestone_3:M3_unit|RAM3_address[2] ;
; 5:1 ; 2 bits ; 6 LEs ; 2 LEs ; 4 LEs ; Yes ; |PROJECT|UART_SRAM_interface:UART_unit|new_line_count[1] ;