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losfroger/timer-vhdl

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Universidad de Guanajuato

Timer VHDL

Proyecto final de electrónica digital

Temporizador al cual se le introducen minutos y segundos, con un máximo de 9 minutos y 59 segundos. Al acabar el tiempo suena el tono de alarma a través de un buzzer colocado en la salida de 3.3V de una FPGA DE0.

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Demo 1

Demo 2

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Temporizador hecho con vhdl

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